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PowerPAK ? ChipFET ? DUAL PAD ?
D
Vishay Siliconix
D1 (8)
D1 (7)
D2 (6)
S2 (5)
E
SI (1)
GI (2)
S2 (3)
G2 (4)
Z
C
A
b
e
A 1
S I (1) G I (2) S 2 (3)
G 2 (4)
L
K
DETAIL Z
E 2
H
D1 (8) D1 (7)
D2 (6) D2 (5)
K 1
Backside view of dual pad
MILLIMETERS
INCHES
DIM.
A
A 1
b
C
D
D 2
E
E 2
MIN.
0.70
0
0.25
0.15
2.92
1.07
1.82
0.92
NOM.
0.75
-
0.30
0.20
3.00
1.20
1.90
1.05
MAX.
0.85
0.05
0.35
0.25
3.08
1.32
1.98
1.17
MIN.
0.028
0
0.010
0.006
0.115
0.042
0.072
0.036
NOM.
0.030
-
0.012
0.008
0.118
0.047
0.075
0.041
MAX.
0.033
0.002
0.014
0.010
0.121
0.052
0.078
0.046
e
0.65 BSC
0.026 BSC
H
K
K 1
L
0.15
0.20
0.20
0.30
0.20
-
-
0.35
0.25
-
-
0.40
0.006
0.008
0.008
0.012
0.008
-
-
0.014
0.010
-
-
0.016
ECN: C10-0618-Rev. C, 19-Jul-10
DWG: 5940
Revision: 19-Jul-10
1
Document Number: 73204
For technical questions, contact: pmostechsupport@vishay.com
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ARE SUBJECT TO SPECIFIC DISCLAIMERS, SET FORTH AT www.vishay.com/doc?91000
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